
「アナデバ社(ADI社)のWeb記事『StudentZone』を初回からすべて読む」の2021年12月号はCMOSインバータを反転アンプにつかう件です。「その1」なのでLTspiceで雰囲気を味わう(お茶を濁す)回なのです。ま、実習やろうにも手頃な「アンバッファ」タイプのCMOSインバータが手元にない、と。
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前回までのように、うさちゃんRabbit4000をイーサネット経由で動かしている分には、手足のGPIO端子などは気にする必要はありません。でもそろそろマイコンらしい仕事をさせたいです。勿論、http経由でですが。しかし、うさちゃんのIO端子について全く分かってないことが発覚。大慌てで調べましたです。

前回はLogisimのライブラリから符号無整数の比較器「組み合わせ回路」をVerilogしてみました。今回はバイナリカウンタ「順序回路」をVerilogしてみます。端から部品を練習すれば、そのうち色々できるだろ~という勝手な思い込みです。記述のお作法もいろいろあるのだけれど、今のところ成り行き。徐々に修正する予定。

前回、入力信号が3V振幅ならば、綺麗に線形な結果が得られる筈のXYグラフが折れ曲がっておりました。何故に?そこでちょっと実機回路を勝手改変して「線形な結果」が得られるようにしてみました。得られたのは良いけれども、なぜSPICEの結果と実機の結果がこうも違うのか?SPICEあるある?SPICEの闇?違うか。
“お手軽ツールで今更学ぶアナログ(105) ディスクリート・トランジスタでアンプ出力段その3” の続きを読む

前回は、論理圧縮ツール Espresso を使うことができる LogicFriday を試してみました。今回は再びLogicsimへ戻ります。しかし後々のこと(なんだそれ)を考えるとライブラリがVerilogでも書けた方が安心。ということでVerilog化始めました。まずは組み合わせ回路、コンパレータから。 “帰らざるMOS回路(24)今時ゲートレベルでもあるまいに。ライブラリをVerilogしてみる” の続きを読む

前回、アナデバ様のWebツールを使ってアクティブ・フィルタ(手元の部品を指定したので精度的にレコメンドより落ちているケド)を「設計」しLTspiceでシミュレーションしてみました。今回は作成された回路をブレッドボード上に組み立てて特性を観察してみたの回です。何も分かっちゃいなくても回路は動くと。いいのかそんなことで。

前回、Verilogを使えるようにしたので、さらに歯止めが効かなくなりました。普通なら、Verilog書いて、シミュレーションしてOKなら、論理合成デス。でもま、今回商用ツール使っている分けでもなく、またゲートレベルなので合成は無理、と思っていたら、面白いツールがありました。LogicFridayとな。

別件で入力信号にLPFかけたくなりました。RCパッシブフィルタであれば自分でも何とかなりそう。でもそれでは進歩がない、と。そういえばアナデバ様のWebツールでフィルタをつくれるものがあった筈。今回はWebツールで「所望の」アクティブフィルタを構成した上で、ダウンロードしたSPICEモデルをシミュレーションしてみました。

ラズパイのI2Cバスを5V化した先に接続してあるIO Expander MCP23017、いままで全ビット出力設定でした。今回から入力ビットを「混ぜられる」ようにしたいと思います。本当は1ビット毎に方向設定可能なのですが、テスト用のコードを書くのがメンドイのでPortA/Bの8ビット単位で設定できるようにしてみました。 “やっつけな日常(22) ラズパイ、IO Expander制御、入力モード追加” の続きを読む